1.quartus ii13.1与13.0有什么区别
2.Verilog（Quartus）和ModelSim
3.μC_OS的环境配置需要准备什么软件？
4.如何用Quartus II对用Verilog HDL语言编写的源码进行仿真 ？

quartus ii13.1与13.0有什么区别

       Altera公司今天宣布发布Quartus® II软件.1版，通过大幅度优化算法以及增强并行处理，与前一版本相比，编译时间平均缩短了%，最大达到%，进一步扩展了在软件效能方面的个人免挂机支付源码业界领先优势。软件还包括最新的快速重新编译特性，适用于客户对Altera Stratix® V FPGA设计进行少量源代码改动的情形。采用快速重新编译特性，客户可以重新使用以前的编译结果，从而保持性能，不需要前端设计划分，进一步将编译时间缩短了%。

        软件和IP产品市场主任Alex Grbic评论说：“我们的众包系统免费源码Quartus II软件一直能够随每一代FPGA产品一起发展，这是源于我们一开始便设计好的优异成熟的软件体系结构。采用Quartus II最新版软件的新功能以及增强特性，我们高端FPGA的编译时间比竞争产品快2倍，性能提高了%。”

        这一最新版还增强了高级设计工具，扩展了Quartus II软件的领先优势，因此，客户提高了效能，受益于Altera器件前沿的功能。Quartus II软件.1版增强了其Qsys系统集成工具、DSP Builder基于模型的设计环境，以及面向OpenCL™的Altera SDK。

        ·Altera Qsys系统集成工具自动连接知识产权(IP)功能和子系统，看盘分时买入源码从而显著节省了时间，减轻了FPGA设计工作量。使用Qsys，设计人员能够无缝集成多种业界标准接口，包括，Avalon、ARM® AMBA AXI、APB和AHB接口，加速了系统开发。在Quartus II软件v.1中，Qsys增强了系统可视化能力，支持同时查看Qsys系统的多个视图，进一步提高了效能。懂车帝APP 源码这样，通过在新外设中增加或者连接组件，更容易修改您的系统。

        ·面向OpenCL的Altera SDK现在全面投产，是业界唯一通过一致性测试的FPGA OpenCL解决方案，符合Khronos集团定义的OpenCL规范。它提供了软件友好的编程环境，在Altera优选电路板合作伙伴计划电路板上使用FPGA，或者使用Altera Cyclone® V SoC开发板时，支持在Altera SoC上设计高性能系统。

        ·Altera DSP Builder设计工具支持系统开发人员在其数字信号处理(DSP)设计中高效的实现高性能定点和浮点算法。为工程师在设计过程中提供更多的选择，更加灵活的淘宝自动发布宝贝源码设计，Altera DSP Builder高级模块库现在可以集成到MathWorks HDL Coder中。对快速傅里叶变换(FFT)处理的改进包括运行时长度可变FFT，以及GHz极高数据速率的超采样FFT，以优异的性能和多种灵活的选择来实现这些通用DSP功能。

        Quartus II软件.1版包括Altera同类最佳的IP，延时降低了%，资源利用率提高了%以上，同时保持了客户的性能不变，也保持了最常用和性能最高的IP的吞吐量。这些IP内核包括G、G和G以太网，以及G至G Interlaken。

        关于Quartus II软件v.1特性的详细信息，请访问Altera的Quartus II软件新增功能网页。

        价格和供货信息

        现在可以下载订购版和免费网络版的Quartus II软件v.1。Altera的软件订购程序将软件产品和维持费用合并在一个年度订购支付中，简化了获取Altera设计软件的过程。Quartus II软件订户可以收到ModelSim®-Altera入门版软件，以及IP基本套装的全部许可，它包括Altera最流行的IP (DSP和存储器)内核。一个节点锁定的PC许可年度软件订购价格为2,美元，可以通过Altera的eStore购买。

        对于一个节点锁定的PC许可，面向OpenCL的SDK年度软件订购的价格是美元。关于OpenCL的Altera优选电路板合作伙伴计划及其合作伙伴的其他信息，或者希望了解所支持的所有电路板的详细信息，并进行购买，请访问Altera网站的OpenCL部分。

Verilog（Quartus）和ModelSim

       modelsim是第三方EDA工具，只能用来做仿真，虽然功能单一，但是做得很强大（相比较Q2的仿真能力）

       Q2也可以进行简单的仿真（很有限），但是ALTERA FPGA的编译、综合、布局布线等的指定工具，也就是说可以跑完整个流程，甚至可以使用里面自带的sopc nios软核，比较全面，最主要的是可以将自己的设计转化为实际存在的电路，输出想要的电信号！

μC_OS的环境配置需要准备什么软件？

       μC/OS-II的环境配置需要准备以下软件：

       μC/OS-II实时操作系统的源代码，可以从官方网站下载。

       C编译器，例如IAR、GCC等。

       调试器，例如J-Link、ST-Link等。

       仿真器，例如ModelSim、Altera Quartus等。

       文本编辑器，例如Notepad++、Sublime Text等。

       集成开发环境（IDE），例如Keil、Microchip Studio等。

       图形绘图工具，例如CorelDRAW、Adobe Photoshop等。

       版本控制工具，例如Git、SVN等。

       文档生成工具，例如Doxygen、MkDocs等。

       图形化用户界面（GUI）开发工具，例如Qt、wxWidgets等。

       以上软件都需要根据实际情况进行选择和安装。

如何用Quartus II对用Verilog HDL语言编写的源码进行仿真 ？

       O(∩_∩)O~，这个是我当时总结的，希望对你有用!

       1.首先创建一个工程，再在new中新建添加verilog文本，再进行编译！

       2.编译成功后，到file——create/update——create symbol Files for current

       3.成功后到New——Block diagram/Schematic File——在空白处点击鼠标右键——insert——symbol——选择project

       文件夹下的子文件，点OK键——再在空白处点击右键——insert——symbol——选择d:/（安装文件夹）的子文件夹

       primitives下的pin文件夹选择需要的管脚——双击管脚处修改管脚名如a[7..0]——保存文件

       4.建立仿真：在new中选择——打开vector waveform file ——再在View中——选择utility window——Node Finder

       ——点击list找出所有全部复制——关闭后粘贴——点击zoom tool ——点击鼠标右键调节试当的区间——

       点击箭头之后选择要变的数值——之后点击Start simulation进行仿真编译

       你自己按我写的步骤试试看，基本步骤都涵盖在我上面的总结里！！